Les spécifications
Définition

Générateur d'horloge AD9531BCPZ 1,6 GHz Sortie Jitter<1ps Alimentation 3,3V/5V Contrôle SPI Sorties LVDS/PECL Température industrielle pour 5G/Réseau sans fil

CARACTÉRISTIQUES

3 cœurs PLL/VCO entièrement intégrés (PLL1, PLL2 et PLL3) Performance de jitter : 0,462 ps rms typique

PLL1, mode fractionnel-N, bande passante de 12 kHz à 20 MHz

Détection de perte de référence et de verrouillage pour chaque PLL

Traductions de fréquences communes configurables par broche

Synchronisation automatique de toutes les sorties à la mise sous tension

Capacité de synchronisation manuelle des sorties

Boîtier disponible en LFCSP à 88 broches

Détails du PLL1

Modes fractionnel-N/entier-N

VCXO externe en option

Mode de retard fixe pour un décalage de phase statique constant

2 entrées d'horloge de référence

Format d'entrée : différentiel/simple

Plage de fréquences : 9,5 MHz à 260 MHz

Commutation de référence : manuelle/automatique

10 sorties HSTL/CMOS à très faible jitter jusqu'à 400 MHz Détails du PLL2

Mode entier-N (1 entrée d'horloge de référence)

Format d'entrée : différentiel/simple/cristal1

Plage de fréquences : 9,5 MHz à 250 MHz

12 sorties HSTL/CMOS jusqu'à 400 MHz

Détails du PLL3

Mode entier-N (1 entrée d'horloge de référence)

Format d'entrée : différentiel/simple/cristal1

Plage de fréquences : 9,5 MHz à 250 MHz

12 sorties HSTL/CMOS jusqu'à 400 MHz

Détails du PLL3

Mode entier-N (1 entrée d'horloge de référence)

Plage de fréquences : 9,5 MHz à 100 MHz

Format d'entrée : différentiel/cristal (prend en charge un résonateur à cristal de quartz taillé AT de 25 MHz à

50 MHz)

2 sorties HSTL/LVDS/CMOS jusqu'à 400 MHz/150 MHz (différentiel/CMOS)

APPLICATIONS

Cadencement du contrôleur d'équipement radio

Génération et distribution d'horloge à faible jitter/bruit de phase

Génération et traduction d'horloge pour SONET, 10GE, 10G FC et autres protocoles 10 Gbit/s

Cartes de ligne réseau 40 Gbit/s/100 Gbit/s, y compris SONET, Ethernet synchrone, OTU2/3/4

Correction d'erreur directe (G.710)

Émetteurs-récepteurs sans fil haute performance

ATE et instrumentation haute performance

Infrastructures à large bande

Cartes de ligne Ethernet, commutateurs et routeurs

SATA et PCI-express

DESCRIPTION

L'AD9531 fournit une fonction de générateur d'horloge multi-sorties et trois cœurs de boucle à verrouillage de phase (PLL) sur puce avec des fréquences et des formats de sortie programmables par SPI.

Le PLL1 fournit deux entrées de référence et 10 sorties et comprend quatre configurations de boucle sélectionnables par l'utilisateur. Le PLL dispose d'un filtre de boucle entièrement intégré ne nécessitant qu'un seul condensateur externe (ou un réseau RC série). Le PLL1 offre une large gamme de fréquences de sortie jusqu'à 400 MHz et est capable de fonctionner avec un oscillateur à cristal contrôlé en tension (VCXO) et un filtre de boucle externes, au lieu de l'oscillateur contrôlé en tension (VCO) et du filtre de boucle intégrés.

Le PLL2 est un PLL entier-N fournissant une seule entrée de référence et 12 sorties. Le PLL2 synthétise des fréquences de sortie jusqu'à 400 MHz à partir de la source REF2_x et synchronise les horloges de sortie à la référence d'entrée.

Le PLL3 fournit une seule entrée de référence et deux sorties. Le PLL3 synthétise des fréquences de sortie jusqu'à 400 MHz à partir de la source REF3_x et synchronise les horloges de sortie à la référence d'entrée. L'AD9531 est disponible en LFCSP à 88 broches et est spécifié sur la plage de températures de fonctionnement de −40°C à +85°C.

Dans toute cette fiche technique, les broches multifonctions, telles que LOR/M4, sont désignées soit par le nom complet de la broche, soit par une seule fonction de la broche (par exemple, LOR, lorsque seule cette fonction est pertinente). Dans d'autres cas, le texte et les figures de cette fiche technique contiennent des références à un canal plutôt qu'à une broche. Par exemple, REF_A fait référence au canal REF_A plutôt qu'aux broches REF_AP et REF_AN. De même, OUT3_1 fait référence au canal 1 du PLL3 plutôt qu'aux broches OUT3_1P et OUT3_1N. De plus, une notation abrégée pour une paire de broches remplace une référence explicite à chaque broche (par exemple, REF_Ax signifie les broches REF_AN et REF_AP.).

INFORMATION

Catégorie
Fabricant
Analog Devices Inc.
Série
-
Emballage
Plateau
Statut de la pièce
Obsolète
DigiKey Programmable
Non vérifié
PLL
Oui
Entrée
CMOS, LVDS, LVPECL, Cristal
Sortie
CMOS, HSTL, LVDS
Nombre de circuits
3
Ratio - Entrée:Sortie
2:10, 1:12, 1:2
Différentiel - Entrée:Sortie
Oui/Oui
Fréquence - Max
400MHz
Diviseur/Multiplicateur
Oui/Oui
Tension - Alimentation
1,71 V ~ 3,465 V
Température de fonctionnement
-40°C ~ 85°C
Type de montage
Montage en surface
Boîtier / Boîtier
88-VFQFN Pad exposé, CSP
Boîtier du dispositif du fournisseur
88-LFCSP-VQ (12x12)
Numéro de produit de base

Dessin

Générateur d'horloge AD9531BCPZ, sortie 1,6 GHz, gigue <1 ps, alimentation 3,3 V/5 V, contrôle SPI, sorties LVDS/PECL, température industrielle, pour 5G/sans fil/réseau

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